sarter kit et codec aic23

Starter kit dskC6713 et codec
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LE STARTER KIT TMS320C6713 DSK
1.1. Block Diagram
Le DSP6713 à Fck_DSP = 225 MHz
Un interface analogique AIC (Analog Interface Adaptator) AIC23 Codec Stereo
Une SDRAM de 16M octets
Une mémoire FLASH de 512koctets (dont 256 utilisable pour stocker des config par
default).
4 Leds et 4 interrupteurs
Entrée et sorties Audio « Line » (gain fixe)
Entrée Micro, sortie Casque (gain ajustable)
Possibilité de cartes filles.
Emulation JTAB par prise USB
Un circuit logique programmable CPLD reliant ensemble les composants. Des registres de
configurations de la carte sont dans ce CPLD.
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1.2. Memory Map
EMIF = External Memory Interface à 32 bits d’adresse.
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1.3. Configuration matérielle
Au Reset, diverses configurations sont possibles selon 4 switch (block SW3 de la
maquette).
Pour nos TP, il faut :
SW1 SW2 SW3 Off
SW4
On (utilisation de quelques io du GPIO)
On a alors la configuration suivante pour les périphériques
On pourra utiliser les entrée/sorties (GPIO) : 0 1 2 3 et 8 9 10 11 12 13 14 15
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1.4. Le Codec AIC 23
Circuit d’interface analogique à haute performance. Fech de 8kHz à 96kHz. SNR de 90dB.
Stéréo, pour audio de haute fidélité.
Deux canaux série rapides sur 16 bits (type SPI) :
McBSP0 Configuration des registres internes (9bits) de l’AIC23 (unidirectionnel)
McBSP1 les échantillons IO (bidirectionnel)
Le codec est le maître et génère lui même Ck des bus SPI.
Fck_aic = 12 MHz
Fech (de 8kHz à 86kHz) est fixée dans le registre 8 : SAMPLERATE
Line Input :
Vmax analogique
±1,3Vcrête Ze voisin de 20kΩ
Micro input
Line output :
Zs = 10 KΩ 1Veff
Heaphone output : 30mW dans 32Ω
Fech max :
96 kHz
Echantillons audio : 16 bits
1.4.1. Les 10 registres de contrôle
Mots de contrôle de 16 bits
Les CR de 9 bits chacun à placer dans la partie basse
Les 7 bits de partie haute contenant l’adresse (de 0 à 9)
Volume des lignes d’entrée LINE et Micro, exemple :
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Sur la maquette : 0 1C
soit non muette, et
5
+1,5 dB (idem pour Right Input)
Analog Audio Path Control
Sur la maquette: 0 11
soit added sidetone -6dB, DAC validé, ligne d’entrée LINE
Digital audio path control
Sur la maquette: 0 00
soit DAC non muet, Filtre passe haut ADC validé
Power down Control
Sur la maquette: 0 00
soit tout validé, details non fournis
Digital audio interface format
Sur la maquette: 0 43
soit 16 bits, format SPI type DSP texas …. Pas plus de detail.
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Sample Rate control
Sur la maquette: 0 01
soit Fech = 48 kHz Clock mode: USB (même spécification
qu’un bus USB) Oversampling rate 250Fs (pour les filtres ADC et DAC)
Digital Interface Activation
Sur la maquette: 0 01
Actif
Reset Register (adresse 15)
Ecrire 0 provoque un Reset general
1.4.2. Filtres IO
Ils sont en fait numériques avec un sur-échantillonnage de ici de 250 cas de la maquette.
Filtre d’entrée CAN
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Filtre de sortie (CNA)
Temps de propagation de groupe :
12 Output samples
1.5. Dynamique des échantillons IO
Dans ce genre de circuits, CAN et CNA peuvent posséder 14 ou 15 ou 16 bits, peu importe
pour la dynamique. Le cadrage étant gauche.
+- 1,3 Volt crête
-32767 à +32767 en Q0(16)
(sur des int de 32 bits)
-1 à ~+1 en Q15(16)
( Q31(32) en fait dans l’extension sur des mots de 32 bits)
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Si on veut travailler sur des flottants de -1 à ~+1, ce qui peut faciliter les études de
dynamique, on divisera par 32768.0 en entrée, on re-multipliera par 32768.0 avant de sortir.
Présence hélas obligatoire :
Du filtre passe bas anti repliement à l’entrée.
De passes hauts supplémentaires en entrée et même en sortie, coupant vers 10 à
20Hz. (bêtes capa de liaison !).
Attention donc lors de vos mesures en TBF !!!